mirror of
https://github.com/ARM-software/arm-trusted-firmware.git
synced 2025-04-23 13:36:05 +00:00
Add Linux DTS files for 32 bit threaded FVPs
RevC models have the MT bit set and the affinities shifted in the MPIDR register. To make the Linux able to boot all CPUs it needs a modified DTS file containing the shifted affinity values. Beside these values the DTS files should be the same so the common part was moved into a new file which is included in the DTS files with shifted and non-shifted affinities. The same setup already exists for 64 bit systems. Signed-off-by: Imre Kis <imre.kis@arm.com> Change-Id: I90f7b9c8d8a24c9b3f97232441dbe0a29aa8976d
This commit is contained in:
Imre Kis
parent
5dbdf8e4ea
commit
1946b86843
3 changed files with 357 additions and 309 deletions
41
fdts/fvp-base-gicv3-psci-aarch32-1t.dts
Normal file
41
fdts/fvp-base-gicv3-psci-aarch32-1t.dts
Normal file
|
|
@ -0,0 +1,41 @@
|
||||||
|
/*
|
||||||
|
* Copyright (c) 2019, Arm Limited. All rights reserved.
|
||||||
|
*
|
||||||
|
* SPDX-License-Identifier: BSD-3-Clause
|
||||||
|
*/
|
||||||
|
|
||||||
|
/dts-v1/;
|
||||||
|
|
||||||
|
/include/ "fvp-base-gicv3-psci-aarch32-common.dtsi"
|
||||||
|
|
||||||
|
&CPU0 {
|
||||||
|
reg = <0x0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&CPU1 {
|
||||||
|
reg = <0x100>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&CPU2 {
|
||||||
|
reg = <0x200>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&CPU3 {
|
||||||
|
reg = <0x300>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&CPU4 {
|
||||||
|
reg = <0x10000>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&CPU5 {
|
||||||
|
reg = <0x10100>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&CPU6 {
|
||||||
|
reg = <0x10200>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&CPU7 {
|
||||||
|
reg = <0x10300>;
|
||||||
|
};
|
||||||
314
fdts/fvp-base-gicv3-psci-aarch32-common.dtsi
Normal file
314
fdts/fvp-base-gicv3-psci-aarch32-common.dtsi
Normal file
|
|
@ -0,0 +1,314 @@
|
||||||
|
/*
|
||||||
|
* Copyright (c) 2016-2019, ARM Limited and Contributors. All rights reserved.
|
||||||
|
*
|
||||||
|
* SPDX-License-Identifier: BSD-3-Clause
|
||||||
|
*/
|
||||||
|
|
||||||
|
/memreserve/ 0x80000000 0x00010000;
|
||||||
|
|
||||||
|
/ {
|
||||||
|
};
|
||||||
|
|
||||||
|
/ {
|
||||||
|
model = "FVP Base";
|
||||||
|
compatible = "arm,vfp-base", "arm,vexpress";
|
||||||
|
interrupt-parent = <&gic>;
|
||||||
|
#address-cells = <2>;
|
||||||
|
#size-cells = <2>;
|
||||||
|
|
||||||
|
chosen { };
|
||||||
|
|
||||||
|
aliases {
|
||||||
|
serial0 = &v2m_serial0;
|
||||||
|
serial1 = &v2m_serial1;
|
||||||
|
serial2 = &v2m_serial2;
|
||||||
|
serial3 = &v2m_serial3;
|
||||||
|
};
|
||||||
|
|
||||||
|
psci {
|
||||||
|
compatible = "arm,psci-1.0", "arm,psci-0.2", "arm,psci";
|
||||||
|
method = "smc";
|
||||||
|
cpu_suspend = <0x84000001>;
|
||||||
|
cpu_off = <0x84000002>;
|
||||||
|
cpu_on = <0x84000003>;
|
||||||
|
sys_poweroff = <0x84000008>;
|
||||||
|
sys_reset = <0x84000009>;
|
||||||
|
};
|
||||||
|
|
||||||
|
cpus {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
|
||||||
|
cpu-map {
|
||||||
|
cluster0 {
|
||||||
|
core0 {
|
||||||
|
cpu = <&CPU0>;
|
||||||
|
};
|
||||||
|
core1 {
|
||||||
|
cpu = <&CPU1>;
|
||||||
|
};
|
||||||
|
core2 {
|
||||||
|
cpu = <&CPU2>;
|
||||||
|
};
|
||||||
|
core3 {
|
||||||
|
cpu = <&CPU3>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
cluster1 {
|
||||||
|
core0 {
|
||||||
|
cpu = <&CPU4>;
|
||||||
|
};
|
||||||
|
core1 {
|
||||||
|
cpu = <&CPU5>;
|
||||||
|
};
|
||||||
|
core2 {
|
||||||
|
cpu = <&CPU6>;
|
||||||
|
};
|
||||||
|
core3 {
|
||||||
|
cpu = <&CPU7>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
idle-states {
|
||||||
|
entry-method = "arm,psci";
|
||||||
|
|
||||||
|
CPU_SLEEP_0: cpu-sleep-0 {
|
||||||
|
compatible = "arm,idle-state";
|
||||||
|
local-timer-stop;
|
||||||
|
arm,psci-suspend-param = <0x0010000>;
|
||||||
|
entry-latency-us = <40>;
|
||||||
|
exit-latency-us = <100>;
|
||||||
|
min-residency-us = <150>;
|
||||||
|
};
|
||||||
|
|
||||||
|
CLUSTER_SLEEP_0: cluster-sleep-0 {
|
||||||
|
compatible = "arm,idle-state";
|
||||||
|
local-timer-stop;
|
||||||
|
arm,psci-suspend-param = <0x1010000>;
|
||||||
|
entry-latency-us = <500>;
|
||||||
|
exit-latency-us = <1000>;
|
||||||
|
min-residency-us = <2500>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU0:cpu@0 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "arm,armv8";
|
||||||
|
reg = <0x0>;
|
||||||
|
enable-method = "psci";
|
||||||
|
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU1:cpu@1 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "arm,armv8";
|
||||||
|
reg = <0x1>;
|
||||||
|
enable-method = "psci";
|
||||||
|
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU2:cpu@2 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "arm,armv8";
|
||||||
|
reg = <0x2>;
|
||||||
|
enable-method = "psci";
|
||||||
|
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU3:cpu@3 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "arm,armv8";
|
||||||
|
reg = <0x3>;
|
||||||
|
enable-method = "psci";
|
||||||
|
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU4:cpu@100 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "arm,armv8";
|
||||||
|
reg = <0x100>;
|
||||||
|
enable-method = "psci";
|
||||||
|
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU5:cpu@101 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "arm,armv8";
|
||||||
|
reg = <0x101>;
|
||||||
|
enable-method = "psci";
|
||||||
|
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU6:cpu@102 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "arm,armv8";
|
||||||
|
reg = <0x102>;
|
||||||
|
enable-method = "psci";
|
||||||
|
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU7:cpu@103 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "arm,armv8";
|
||||||
|
reg = <0x103>;
|
||||||
|
enable-method = "psci";
|
||||||
|
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
};
|
||||||
|
|
||||||
|
L2_0: l2-cache0 {
|
||||||
|
compatible = "cache";
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
memory@80000000 {
|
||||||
|
device_type = "memory";
|
||||||
|
reg = <0x00000000 0x80000000 0 0x7F000000>,
|
||||||
|
<0x00000008 0x80000000 0 0x80000000>;
|
||||||
|
};
|
||||||
|
|
||||||
|
gic: interrupt-controller@2f000000 {
|
||||||
|
compatible = "arm,gic-v3";
|
||||||
|
#interrupt-cells = <3>;
|
||||||
|
#address-cells = <2>;
|
||||||
|
#size-cells = <2>;
|
||||||
|
ranges;
|
||||||
|
interrupt-controller;
|
||||||
|
reg = <0x0 0x2f000000 0 0x10000>, // GICD
|
||||||
|
<0x0 0x2f100000 0 0x200000>, // GICR
|
||||||
|
<0x0 0x2c000000 0 0x2000>, // GICC
|
||||||
|
<0x0 0x2c010000 0 0x2000>, // GICH
|
||||||
|
<0x0 0x2c02f000 0 0x2000>; // GICV
|
||||||
|
interrupts = <1 9 4>;
|
||||||
|
|
||||||
|
its: its@2f020000 {
|
||||||
|
compatible = "arm,gic-v3-its";
|
||||||
|
msi-controller;
|
||||||
|
reg = <0x0 0x2f020000 0x0 0x20000>; // GITS
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
timer {
|
||||||
|
compatible = "arm,armv8-timer";
|
||||||
|
interrupts = <1 13 0xff01>,
|
||||||
|
<1 14 0xff01>,
|
||||||
|
<1 11 0xff01>,
|
||||||
|
<1 10 0xff01>;
|
||||||
|
clock-frequency = <100000000>;
|
||||||
|
};
|
||||||
|
|
||||||
|
timer@2a810000 {
|
||||||
|
compatible = "arm,armv7-timer-mem";
|
||||||
|
reg = <0x0 0x2a810000 0x0 0x10000>;
|
||||||
|
clock-frequency = <100000000>;
|
||||||
|
#address-cells = <2>;
|
||||||
|
#size-cells = <2>;
|
||||||
|
ranges;
|
||||||
|
frame@2a830000 {
|
||||||
|
frame-number = <1>;
|
||||||
|
interrupts = <0 26 4>;
|
||||||
|
reg = <0x0 0x2a830000 0x0 0x10000>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
pmu {
|
||||||
|
compatible = "arm,armv8-pmuv3";
|
||||||
|
interrupts = <0 60 4>,
|
||||||
|
<0 61 4>,
|
||||||
|
<0 62 4>,
|
||||||
|
<0 63 4>;
|
||||||
|
};
|
||||||
|
|
||||||
|
smb {
|
||||||
|
compatible = "simple-bus";
|
||||||
|
|
||||||
|
#address-cells = <2>;
|
||||||
|
#size-cells = <1>;
|
||||||
|
ranges = <0 0 0 0x08000000 0x04000000>,
|
||||||
|
<1 0 0 0x14000000 0x04000000>,
|
||||||
|
<2 0 0 0x18000000 0x04000000>,
|
||||||
|
<3 0 0 0x1c000000 0x04000000>,
|
||||||
|
<4 0 0 0x0c000000 0x04000000>,
|
||||||
|
<5 0 0 0x10000000 0x04000000>;
|
||||||
|
|
||||||
|
#interrupt-cells = <1>;
|
||||||
|
interrupt-map-mask = <0 0 63>;
|
||||||
|
interrupt-map = <0 0 0 &gic 0 0 0 0 4>,
|
||||||
|
<0 0 1 &gic 0 0 0 1 4>,
|
||||||
|
<0 0 2 &gic 0 0 0 2 4>,
|
||||||
|
<0 0 3 &gic 0 0 0 3 4>,
|
||||||
|
<0 0 4 &gic 0 0 0 4 4>,
|
||||||
|
<0 0 5 &gic 0 0 0 5 4>,
|
||||||
|
<0 0 6 &gic 0 0 0 6 4>,
|
||||||
|
<0 0 7 &gic 0 0 0 7 4>,
|
||||||
|
<0 0 8 &gic 0 0 0 8 4>,
|
||||||
|
<0 0 9 &gic 0 0 0 9 4>,
|
||||||
|
<0 0 10 &gic 0 0 0 10 4>,
|
||||||
|
<0 0 11 &gic 0 0 0 11 4>,
|
||||||
|
<0 0 12 &gic 0 0 0 12 4>,
|
||||||
|
<0 0 13 &gic 0 0 0 13 4>,
|
||||||
|
<0 0 14 &gic 0 0 0 14 4>,
|
||||||
|
<0 0 15 &gic 0 0 0 15 4>,
|
||||||
|
<0 0 16 &gic 0 0 0 16 4>,
|
||||||
|
<0 0 17 &gic 0 0 0 17 4>,
|
||||||
|
<0 0 18 &gic 0 0 0 18 4>,
|
||||||
|
<0 0 19 &gic 0 0 0 19 4>,
|
||||||
|
<0 0 20 &gic 0 0 0 20 4>,
|
||||||
|
<0 0 21 &gic 0 0 0 21 4>,
|
||||||
|
<0 0 22 &gic 0 0 0 22 4>,
|
||||||
|
<0 0 23 &gic 0 0 0 23 4>,
|
||||||
|
<0 0 24 &gic 0 0 0 24 4>,
|
||||||
|
<0 0 25 &gic 0 0 0 25 4>,
|
||||||
|
<0 0 26 &gic 0 0 0 26 4>,
|
||||||
|
<0 0 27 &gic 0 0 0 27 4>,
|
||||||
|
<0 0 28 &gic 0 0 0 28 4>,
|
||||||
|
<0 0 29 &gic 0 0 0 29 4>,
|
||||||
|
<0 0 30 &gic 0 0 0 30 4>,
|
||||||
|
<0 0 31 &gic 0 0 0 31 4>,
|
||||||
|
<0 0 32 &gic 0 0 0 32 4>,
|
||||||
|
<0 0 33 &gic 0 0 0 33 4>,
|
||||||
|
<0 0 34 &gic 0 0 0 34 4>,
|
||||||
|
<0 0 35 &gic 0 0 0 35 4>,
|
||||||
|
<0 0 36 &gic 0 0 0 36 4>,
|
||||||
|
<0 0 37 &gic 0 0 0 37 4>,
|
||||||
|
<0 0 38 &gic 0 0 0 38 4>,
|
||||||
|
<0 0 39 &gic 0 0 0 39 4>,
|
||||||
|
<0 0 40 &gic 0 0 0 40 4>,
|
||||||
|
<0 0 41 &gic 0 0 0 41 4>,
|
||||||
|
<0 0 42 &gic 0 0 0 42 4>;
|
||||||
|
|
||||||
|
/include/ "rtsm_ve-motherboard-aarch32.dtsi"
|
||||||
|
};
|
||||||
|
|
||||||
|
panels {
|
||||||
|
panel@0 {
|
||||||
|
compatible = "panel";
|
||||||
|
mode = "XVGA";
|
||||||
|
refresh = <60>;
|
||||||
|
xres = <1024>;
|
||||||
|
yres = <768>;
|
||||||
|
pixclock = <15748>;
|
||||||
|
left_margin = <152>;
|
||||||
|
right_margin = <48>;
|
||||||
|
upper_margin = <23>;
|
||||||
|
lower_margin = <3>;
|
||||||
|
hsync_len = <104>;
|
||||||
|
vsync_len = <4>;
|
||||||
|
sync = <0>;
|
||||||
|
vmode = "FB_VMODE_NONINTERLACED";
|
||||||
|
tim2 = "TIM2_BCD", "TIM2_IPC";
|
||||||
|
cntl = "CNTL_LCDTFT", "CNTL_BGR", "CNTL_LCDVCOMP(1)";
|
||||||
|
caps = "CLCD_CAP_5551", "CLCD_CAP_565", "CLCD_CAP_888";
|
||||||
|
bpp = <16>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
@ -1,316 +1,9 @@
|
||||||
/*
|
/*
|
||||||
* Copyright (c) 2016-2017, ARM Limited and Contributors. All rights reserved.
|
* Copyright (c) 2016-2019, ARM Limited and Contributors. All rights reserved.
|
||||||
*
|
*
|
||||||
* SPDX-License-Identifier: BSD-3-Clause
|
* SPDX-License-Identifier: BSD-3-Clause
|
||||||
*/
|
*/
|
||||||
|
|
||||||
/dts-v1/;
|
/dts-v1/;
|
||||||
|
|
||||||
/memreserve/ 0x80000000 0x00010000;
|
/include/ "fvp-base-gicv3-psci-aarch32-common.dtsi"
|
||||||
|
|
||||||
/ {
|
|
||||||
};
|
|
||||||
|
|
||||||
/ {
|
|
||||||
model = "FVP Base";
|
|
||||||
compatible = "arm,vfp-base", "arm,vexpress";
|
|
||||||
interrupt-parent = <&gic>;
|
|
||||||
#address-cells = <2>;
|
|
||||||
#size-cells = <2>;
|
|
||||||
|
|
||||||
chosen { };
|
|
||||||
|
|
||||||
aliases {
|
|
||||||
serial0 = &v2m_serial0;
|
|
||||||
serial1 = &v2m_serial1;
|
|
||||||
serial2 = &v2m_serial2;
|
|
||||||
serial3 = &v2m_serial3;
|
|
||||||
};
|
|
||||||
|
|
||||||
psci {
|
|
||||||
compatible = "arm,psci-1.0", "arm,psci-0.2", "arm,psci";
|
|
||||||
method = "smc";
|
|
||||||
cpu_suspend = <0x84000001>;
|
|
||||||
cpu_off = <0x84000002>;
|
|
||||||
cpu_on = <0x84000003>;
|
|
||||||
sys_poweroff = <0x84000008>;
|
|
||||||
sys_reset = <0x84000009>;
|
|
||||||
};
|
|
||||||
|
|
||||||
cpus {
|
|
||||||
#address-cells = <1>;
|
|
||||||
#size-cells = <0>;
|
|
||||||
|
|
||||||
cpu-map {
|
|
||||||
cluster0 {
|
|
||||||
core0 {
|
|
||||||
cpu = <&CPU0>;
|
|
||||||
};
|
|
||||||
core1 {
|
|
||||||
cpu = <&CPU1>;
|
|
||||||
};
|
|
||||||
core2 {
|
|
||||||
cpu = <&CPU2>;
|
|
||||||
};
|
|
||||||
core3 {
|
|
||||||
cpu = <&CPU3>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
cluster1 {
|
|
||||||
core0 {
|
|
||||||
cpu = <&CPU4>;
|
|
||||||
};
|
|
||||||
core1 {
|
|
||||||
cpu = <&CPU5>;
|
|
||||||
};
|
|
||||||
core2 {
|
|
||||||
cpu = <&CPU6>;
|
|
||||||
};
|
|
||||||
core3 {
|
|
||||||
cpu = <&CPU7>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
idle-states {
|
|
||||||
entry-method = "arm,psci";
|
|
||||||
|
|
||||||
CPU_SLEEP_0: cpu-sleep-0 {
|
|
||||||
compatible = "arm,idle-state";
|
|
||||||
local-timer-stop;
|
|
||||||
arm,psci-suspend-param = <0x0010000>;
|
|
||||||
entry-latency-us = <40>;
|
|
||||||
exit-latency-us = <100>;
|
|
||||||
min-residency-us = <150>;
|
|
||||||
};
|
|
||||||
|
|
||||||
CLUSTER_SLEEP_0: cluster-sleep-0 {
|
|
||||||
compatible = "arm,idle-state";
|
|
||||||
local-timer-stop;
|
|
||||||
arm,psci-suspend-param = <0x1010000>;
|
|
||||||
entry-latency-us = <500>;
|
|
||||||
exit-latency-us = <1000>;
|
|
||||||
min-residency-us = <2500>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU0:cpu@0 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "arm,armv8";
|
|
||||||
reg = <0x0>;
|
|
||||||
enable-method = "psci";
|
|
||||||
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU1:cpu@1 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "arm,armv8";
|
|
||||||
reg = <0x1>;
|
|
||||||
enable-method = "psci";
|
|
||||||
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU2:cpu@2 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "arm,armv8";
|
|
||||||
reg = <0x2>;
|
|
||||||
enable-method = "psci";
|
|
||||||
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU3:cpu@3 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "arm,armv8";
|
|
||||||
reg = <0x3>;
|
|
||||||
enable-method = "psci";
|
|
||||||
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU4:cpu@100 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "arm,armv8";
|
|
||||||
reg = <0x100>;
|
|
||||||
enable-method = "psci";
|
|
||||||
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU5:cpu@101 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "arm,armv8";
|
|
||||||
reg = <0x101>;
|
|
||||||
enable-method = "psci";
|
|
||||||
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU6:cpu@102 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "arm,armv8";
|
|
||||||
reg = <0x102>;
|
|
||||||
enable-method = "psci";
|
|
||||||
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU7:cpu@103 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "arm,armv8";
|
|
||||||
reg = <0x103>;
|
|
||||||
enable-method = "psci";
|
|
||||||
cpu-idle-states = <&CPU_SLEEP_0 &CLUSTER_SLEEP_0>;
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
L2_0: l2-cache0 {
|
|
||||||
compatible = "cache";
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
memory@80000000 {
|
|
||||||
device_type = "memory";
|
|
||||||
reg = <0x00000000 0x80000000 0 0x7F000000>,
|
|
||||||
<0x00000008 0x80000000 0 0x80000000>;
|
|
||||||
};
|
|
||||||
|
|
||||||
gic: interrupt-controller@2f000000 {
|
|
||||||
compatible = "arm,gic-v3";
|
|
||||||
#interrupt-cells = <3>;
|
|
||||||
#address-cells = <2>;
|
|
||||||
#size-cells = <2>;
|
|
||||||
ranges;
|
|
||||||
interrupt-controller;
|
|
||||||
reg = <0x0 0x2f000000 0 0x10000>, // GICD
|
|
||||||
<0x0 0x2f100000 0 0x200000>, // GICR
|
|
||||||
<0x0 0x2c000000 0 0x2000>, // GICC
|
|
||||||
<0x0 0x2c010000 0 0x2000>, // GICH
|
|
||||||
<0x0 0x2c02f000 0 0x2000>; // GICV
|
|
||||||
interrupts = <1 9 4>;
|
|
||||||
|
|
||||||
its: its@2f020000 {
|
|
||||||
compatible = "arm,gic-v3-its";
|
|
||||||
msi-controller;
|
|
||||||
reg = <0x0 0x2f020000 0x0 0x20000>; // GITS
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
timer {
|
|
||||||
compatible = "arm,armv8-timer";
|
|
||||||
interrupts = <1 13 0xff01>,
|
|
||||||
<1 14 0xff01>,
|
|
||||||
<1 11 0xff01>,
|
|
||||||
<1 10 0xff01>;
|
|
||||||
clock-frequency = <100000000>;
|
|
||||||
};
|
|
||||||
|
|
||||||
timer@2a810000 {
|
|
||||||
compatible = "arm,armv7-timer-mem";
|
|
||||||
reg = <0x0 0x2a810000 0x0 0x10000>;
|
|
||||||
clock-frequency = <100000000>;
|
|
||||||
#address-cells = <2>;
|
|
||||||
#size-cells = <2>;
|
|
||||||
ranges;
|
|
||||||
frame@2a830000 {
|
|
||||||
frame-number = <1>;
|
|
||||||
interrupts = <0 26 4>;
|
|
||||||
reg = <0x0 0x2a830000 0x0 0x10000>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
pmu {
|
|
||||||
compatible = "arm,armv8-pmuv3";
|
|
||||||
interrupts = <0 60 4>,
|
|
||||||
<0 61 4>,
|
|
||||||
<0 62 4>,
|
|
||||||
<0 63 4>;
|
|
||||||
};
|
|
||||||
|
|
||||||
smb {
|
|
||||||
compatible = "simple-bus";
|
|
||||||
|
|
||||||
#address-cells = <2>;
|
|
||||||
#size-cells = <1>;
|
|
||||||
ranges = <0 0 0 0x08000000 0x04000000>,
|
|
||||||
<1 0 0 0x14000000 0x04000000>,
|
|
||||||
<2 0 0 0x18000000 0x04000000>,
|
|
||||||
<3 0 0 0x1c000000 0x04000000>,
|
|
||||||
<4 0 0 0x0c000000 0x04000000>,
|
|
||||||
<5 0 0 0x10000000 0x04000000>;
|
|
||||||
|
|
||||||
#interrupt-cells = <1>;
|
|
||||||
interrupt-map-mask = <0 0 63>;
|
|
||||||
interrupt-map = <0 0 0 &gic 0 0 0 0 4>,
|
|
||||||
<0 0 1 &gic 0 0 0 1 4>,
|
|
||||||
<0 0 2 &gic 0 0 0 2 4>,
|
|
||||||
<0 0 3 &gic 0 0 0 3 4>,
|
|
||||||
<0 0 4 &gic 0 0 0 4 4>,
|
|
||||||
<0 0 5 &gic 0 0 0 5 4>,
|
|
||||||
<0 0 6 &gic 0 0 0 6 4>,
|
|
||||||
<0 0 7 &gic 0 0 0 7 4>,
|
|
||||||
<0 0 8 &gic 0 0 0 8 4>,
|
|
||||||
<0 0 9 &gic 0 0 0 9 4>,
|
|
||||||
<0 0 10 &gic 0 0 0 10 4>,
|
|
||||||
<0 0 11 &gic 0 0 0 11 4>,
|
|
||||||
<0 0 12 &gic 0 0 0 12 4>,
|
|
||||||
<0 0 13 &gic 0 0 0 13 4>,
|
|
||||||
<0 0 14 &gic 0 0 0 14 4>,
|
|
||||||
<0 0 15 &gic 0 0 0 15 4>,
|
|
||||||
<0 0 16 &gic 0 0 0 16 4>,
|
|
||||||
<0 0 17 &gic 0 0 0 17 4>,
|
|
||||||
<0 0 18 &gic 0 0 0 18 4>,
|
|
||||||
<0 0 19 &gic 0 0 0 19 4>,
|
|
||||||
<0 0 20 &gic 0 0 0 20 4>,
|
|
||||||
<0 0 21 &gic 0 0 0 21 4>,
|
|
||||||
<0 0 22 &gic 0 0 0 22 4>,
|
|
||||||
<0 0 23 &gic 0 0 0 23 4>,
|
|
||||||
<0 0 24 &gic 0 0 0 24 4>,
|
|
||||||
<0 0 25 &gic 0 0 0 25 4>,
|
|
||||||
<0 0 26 &gic 0 0 0 26 4>,
|
|
||||||
<0 0 27 &gic 0 0 0 27 4>,
|
|
||||||
<0 0 28 &gic 0 0 0 28 4>,
|
|
||||||
<0 0 29 &gic 0 0 0 29 4>,
|
|
||||||
<0 0 30 &gic 0 0 0 30 4>,
|
|
||||||
<0 0 31 &gic 0 0 0 31 4>,
|
|
||||||
<0 0 32 &gic 0 0 0 32 4>,
|
|
||||||
<0 0 33 &gic 0 0 0 33 4>,
|
|
||||||
<0 0 34 &gic 0 0 0 34 4>,
|
|
||||||
<0 0 35 &gic 0 0 0 35 4>,
|
|
||||||
<0 0 36 &gic 0 0 0 36 4>,
|
|
||||||
<0 0 37 &gic 0 0 0 37 4>,
|
|
||||||
<0 0 38 &gic 0 0 0 38 4>,
|
|
||||||
<0 0 39 &gic 0 0 0 39 4>,
|
|
||||||
<0 0 40 &gic 0 0 0 40 4>,
|
|
||||||
<0 0 41 &gic 0 0 0 41 4>,
|
|
||||||
<0 0 42 &gic 0 0 0 42 4>;
|
|
||||||
|
|
||||||
/include/ "rtsm_ve-motherboard-aarch32.dtsi"
|
|
||||||
};
|
|
||||||
|
|
||||||
panels {
|
|
||||||
panel@0 {
|
|
||||||
compatible = "panel";
|
|
||||||
mode = "XVGA";
|
|
||||||
refresh = <60>;
|
|
||||||
xres = <1024>;
|
|
||||||
yres = <768>;
|
|
||||||
pixclock = <15748>;
|
|
||||||
left_margin = <152>;
|
|
||||||
right_margin = <48>;
|
|
||||||
upper_margin = <23>;
|
|
||||||
lower_margin = <3>;
|
|
||||||
hsync_len = <104>;
|
|
||||||
vsync_len = <4>;
|
|
||||||
sync = <0>;
|
|
||||||
vmode = "FB_VMODE_NONINTERLACED";
|
|
||||||
tim2 = "TIM2_BCD", "TIM2_IPC";
|
|
||||||
cntl = "CNTL_LCDTFT", "CNTL_BGR", "CNTL_LCDVCOMP(1)";
|
|
||||||
caps = "CLCD_CAP_5551", "CLCD_CAP_565", "CLCD_CAP_888";
|
|
||||||
bpp = <16>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
|
||||||
Loading…
Add table
Reference in a new issue